采用高速FIFO和雙CPU的光纖陀螺捷聯系統

在光纖陀螺構成的捷聯慣導數據采集系統中,采用了雙CPU結構的工作模式,用高速FIFO作為數據交換橋梁.采用FPGA+DSP構建系統,DSP用于捷聯算法解算,FPGA用于DSP與各類傳感器之間的接口,并用軟FIFO成功解決了系統中斷不夠用的問題.最后對光纖陀螺進行了專項測漂與標定,驗證了該系統的數據采集和傳輸的正確性和可靠性.

作 者： 高延濱 曾建輝 孫華 常云萍 GAO Yan-bin ZENG Jian-hui SUN Hua CHANG Yun-ping   作者單位： 哈爾濱工程大學自動化學院,哈爾濱,150001  刊 名： 電光與控制  ISTIC PKU 英文刊名： ELECTRONICS OPTICS & CONTROL  年，卷(期)： 2007 14(6)  分類號： V271.4 TP241.5  關鍵詞： 光纖陀螺   捷聯慣導   數據交換   FPGA   FIFO  

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